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所蔵数 1 在庫数 1 予約数 0

書誌情報サマリ

書名

命令レベル並列処理　

著者名 安藤 秀樹／著
著者名ヨミ アンドウ ヒデキ
出版者 コロナ社
出版年月 2005.10

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No. 所蔵館 配架場所 請求記号 資料番号 資料種別 状態 個人貸出 在庫
1 西部図書館一般書庫54829/5/1101969906一般在庫 可 ○

書誌詳細

この資料の書誌詳細情報です。

タイトルコード 1000000691990
書誌種別 図書
書名 命令レベル並列処理　
書名ヨミ メイレイ レベル ヘイレツ ショリ
プロセッサアーキテクチャとコンパイラ
叢書名 並列処理シリーズ
叢書番号 3
言語区分 日本語
著者名 安藤 秀樹／著
著者名ヨミ アンドウ ヒデキ
出版地 東京
出版者 コロナ社
出版年月 2005.10
本体価格 ￥３２００
ISBN 4-339-02583-6
数量 9,227p
大きさ 22cm
分類記号 548.29
件名 並列処理(コンピュータ)
注記 文献:p212～223
内容紹介 RISC登場以降の命令の並列処理について解説するテキスト。並列処理に対する制約、命令を動的にスケジューリングするスーパスカラプロセッサ及び静的にスケジューリングするVLIWについて説明する。
著者紹介 大阪大学大学院工学研究科博士前期課程修了(電子工学専攻)。博士(工学)。名古屋大学教授。



内容細目

No. 内容タイトル 内容著者１ 内容著者２ 内容著者３ 内容著者４
1 1.命令レベル並列の基礎
2 1.1 はじめに
3 1.2 制約
4 2.スーパスカラプロセッサ
5 2.1 基本構成
6 2.2 動的命令スケジューリング
7 2.3 正確な例外
8 2.4 レジスタリネーミング
9 2.5 ロード/ストア命令のスケジューリング
10 2.6 分岐予測
11 2.7 高バンド幅命令フェッチ
12 2.8 投機的実行の支援
13 2.9 Intel Pentium 4プロセッサ
14 3.VLIWプロセッサ
15 3.1 概要
16 3.2 スーパスカラプロセッサとの比較
17 3.3 スケジューリングアルゴリズムの分類
18 3.4 局所命令スケジューリング
19 3.5 レジスタ割当てとの干渉
20 3.6 広域命令移動の基礎
21 3.7 パーコレーションスケジューリング
22 3.8 トレースベーススケジューリング
23 3.9 ループの最適化
24 3.10 ハードウェア支援
25 3.11 Intel IA-64アーキテクチャ
26 4.おわりに

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